創(chuàng)維e900v21c變磚，ttl連接不上，線刷報(bào)錯(cuò)

dongxuebin · 發(fā)表于 2021-11-24 06:43

創(chuàng)維e900v21c變磚，ttl連接不上，線刷報(bào)錯(cuò)，ttl報(bào)錯(cuò)日志
GXL:BL1:9ac50e:bb16dc;FEAT:ADFC318C:0;POC:3;RCY:0;EMMC:0;READ:0;0.0;CHK:0;
TE: 160377

BL2 Built : 18:58:24, Oct 25 2016.
gxl gc9db010 - xiaobo.gu@droid05

set vcck to 1080 mv
set vddee to 1050 mv
Board ID = 2, adc=154
CPU clk: 1200MHz
2layers board, use ddr_set[0]
DDR chl: Rank0+1 @ 720MHz - FAIL
DDR chl: Rank0 @ 720MHz - FAIL
DDR chl: Rank0 16bit @ 720MHz - FAIL
DDR chl: ERR = @ 720MHz - FAIL
DQS-corr enabled
DDR scramble enabled

線刷報(bào)錯(cuò)日志
0x10105004 romcode/初始化ddr/讀取初始化結(jié)果/命令結(jié)果返回錯(cuò)誤

月光※傾城 · 發(fā)表于 2021-11-24 10:30

hwonamco · 發(fā)表于 2021-11-24 10:39

新款盒子就這樣完結(jié)

水有嘉魚 · 發(fā)表于 2021-11-24 10:48

什么配置型號

lmxx · 發(fā)表于 2021-11-24 11:12

看準(zhǔn)芯片型號，找線刷包，再干

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